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用IP核生成的SRAM怎么写不进数据啊?
zhouxiaohun
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发表于 2008-5-8 15:23
只看该作者
FPGA/CPLD 器件价格查询系统
用IP核生成的SRAM怎么写不进数据啊?
把别的部分都去掉了,只有用IP核生成的一个SRAM,因为数据总线只有一组,所以把din和dout都映射到同一组inout管脚,应该说没什么问题的。
能读出初始数据来。但为什么写不进去数据呢?把时钟频率也降低到15M了,还是不行
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tomljx
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发表于 2008-5-10 01:09
只看该作者
FPGA/CPLD 器件价格查询系统
是用的什么核,如果是用ALTERA的,仔细看看在线帮助,时钟和写信号的关系,一般带有时钟的都是在时钟沿起的作用。在线帮助里可以生成一个图,仔细看看就明白了。
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zhouxiaohun
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发表于 2008-5-10 09:50
只看该作者
FPGA开发板,低价优惠预订中...
搞明白了,就是因为din和dout连在一起数据冲突,但是现在的问题是第一个地址单元(00h)写不进数据,其他的都行。还有就是写某些地址的时候,别的地址有时也被写了,地址线连接正确,不知道是什么原因呢?高手给分析分析?
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