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在华为一般是用VHDL还是Verilog HDL？

imagic

助工

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1# 大 中 小 发表于 2006-3-7 16:18  只看该作者

在华为一般是用VHDL还是Verilog HDL？

从VHDL转到Verilog HDL难吗？

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chairman704

工程师

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2# 大 中 小 发表于 2006-3-7 16:46  只看该作者
兄弟，我帮你顶，
我知道你是谁，哈哈哈！uestc，嘻嘻
五分钟撒谎一次；
十分钟搞笑一次；
二十分钟讲黄色笑话一次。

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kshen

工程师

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3# 大 中 小 发表于 2006-3-7 17:59  只看该作者
华为是用verilog HDL,如果你对vhdl理解很深的话,转应该是很easy!!!

UESTC????
不错的学校!!

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richardnine

工程师

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4# 大 中 小 发表于 2006-3-7 18:34  只看该作者
verilog

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richardnine

工程师

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5# 大 中 小 发表于 2006-3-7 18:35  只看该作者
uestc这次有个事情不好说

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chairman704

工程师

Rank: 2
6# 大 中 小 发表于 2006-3-7 19:34  只看该作者
哈哈哈，楼主大学和我一个寝室的，
我敢肯定是他，
uestc是发生了一件事，哎！
五分钟撒谎一次；
十分钟搞笑一次；
二十分钟讲黄色笑话一次。

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下里瓜人

助工

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7# 大 中 小 发表于 2006-3-7 19:56  只看该作者
楼上的师兄，我也是uestc的，今年毕业，那件过去了，真正的原因到现在还不清楚

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下里瓜人

助工

Rank: 1
8# 大 中 小 发表于 2006-3-7 19:57  只看该作者
我现在也在学fpga,以后还请各位师兄多多指教哈

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handless

高工

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9# 大 中 小 发表于 2006-3-7 22:16  只看该作者
哇，这么多uestc啊，顶一个！

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imagic

助工

Rank: 1
10# 大 中 小 发表于 2006-3-8 11:03  只看该作者
哈哈，想不到在这里碰上主席了。另外，这里有好多校友啊，真高兴，大家多多交流，不管在工作上还是生活上

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ideologist

工程师

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11# 大 中 小 发表于 2006-3-8 22:20  只看该作者
呵呵，这么多校友，握手。

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scngame

助工

Rank: 1
12# 大 中 小 发表于 2006-3-9 17:23  只看该作者
呵呵,我也是UESTC的,毕业一年了,之前在做ARM,现在想学FPGA,请各位校友多指教!

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月影孤丘

工程师

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13# 大 中 小 发表于 2006-3-9 18:59  只看该作者
verilog比VHDL学起来简单的多

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huangcong007

助工

Rank: 1
14# 大 中 小 发表于 2006-3-9 19:46  只看该作者
uestc是什么？？
做我喜欢做的。

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newliujian

工程师

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15# 大 中 小 发表于 2006-3-9 19:52  只看该作者
我也是UESTC的，，03毕业的。。。。我在网上也看到万人坑的事了

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不当乞丐

工程师

Rank: 2
16# 大 中 小 发表于 2006-3-9 20:00  只看该作者
报到，报到，我现在还在UESTC，6年了

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hanjinyue

高工

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17# 大 中 小 发表于 2006-3-9 20:05  只看该作者
到底是什么学校啊.
http://www.edacn.net/blog/index.php/uid/46649.html

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newliujian

工程师

Rank: 2
18# 大 中 小 发表于 2006-3-9 20:06  只看该作者
楼上的，几系的。。。我们可能是一届的喔

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nicat2004

工程师

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19# 大 中 小 发表于 2006-3-9 21:44  只看该作者
呵呵,成都的

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hrblxc

工程师

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20# 大 中 小 发表于 2006-3-12 09:50  只看该作者
wwwwwwwwwwwwwwww

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jplee_dd

工程师

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21# 大 中 小 发表于 2006-3-12 10:51  只看该作者
人真不少！！！！！！！！

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cyud

工程师

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22# 大 中 小 发表于 2006-3-12 11:41  只看该作者
呵呵,这么多UESTC的啊.偶也是啊.不过我不住万人坑,住16栋.

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cyud

工程师

Rank: 2
23# 大 中 小 发表于 2006-3-12 11:43  只看该作者
晕.....................uestc就是电子科技大学嘛.

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liu83yh

工程师

Rank: 2
24# 大 中 小 发表于 2006-3-16 00:31  只看该作者
原来都是一伙的
学习！！！！！

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chyzhj

工程师

Rank: 2
25# 大 中 小 发表于 2006-3-16 00:46  只看该作者
不过很多大项目还是用VHDL写起来容易点的

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myxxyy

副教授

Rank: 4
26# 大 中 小 发表于 2006-3-16 17:02  只看该作者
简单的多我看不一定吧，从基本电路描述来看的话，二者区别不大。
如果从软件转行，那VERILOG是要好学些，但深入下去还是差不太多。
另一个我觉得VHDL没有多行注释的语法是个失误。

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phoenixfeng

高工

Rank: 5Rank: 5
27# 大 中 小 发表于 2006-4-6 21:06  只看该作者
用什么没关系, HDL语言好上手的

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yuan4561

助工

Rank: 1
28# 大 中 小 发表于 2006-4-6 21:41  只看该作者
靠，这多电子科大的！万人坑！！！！！！！！！！！！！
碗掉下来，天大个疤

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Hxtt103

工程师

Rank: 2
29# 大 中 小 发表于 2006-4-15 23:43  只看该作者
来报道了哟，uestc，顶起哈

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yinheng8066

工程师

Rank: 2
30# 大 中 小 发表于 2006-5-1 16:36  只看该作者
电科人好多的

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