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双端口RAM的设计与测试(verilog)

双端口RAM的设计与测试(verilog)

我在学习实例子论坛发表的,可惜没人留意呀
想学习RAM设计和测试的可以借鉴一下
http://www.edacn.net/bbs/thread-99773-1-1.html

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顶了,学习一下,

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LZ好人啊

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学习一下,

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看看,谢谢了。

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回复 1# 的帖子

给我一份pdf的,地址:shitoulian2002@163.com 我也是做这方面的,谢谢!

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******!
相信自己、没有借口!

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不错!谢谢!顶了

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re

OK,thanks

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good

不错!谢谢!顶了

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OK,thanks

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恩,不错,学习了.

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很不错,******

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这样的讨论太好了,那个例子对理解DURAL RAM还是很好的

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牛人的思想就是不一样!谢谢!
学无止境

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thanskk.......

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回复 1# 的帖子

老这个在中作中还是有点用处的

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谢谢了,******

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超赞!!!
不抛弃,不放弃!

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谢谢了。。。。。。。。。。。。。。。

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谢谢,学习来的~!!!

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很的资源啊,看看。。

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