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AS下载中奇怪的问题

字体: 小 中 大 | 打印 发表于: 2008-11-19 17:17    作者: yuxiaohui    来源: EDA中国门户网站

我自己做的板子，用的FPGA是EP2S30，FLASH是EPCS16,JTAG下载正常，AS下载时电脑上显示的是下载完了，但config_done不能置高电平，不知是怎么回事？
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  • sjh75 (2008-11-19 18:03:48)

    说明你的FPGA没法完成配置！下载和配置是两码事。
    下载是从电脑下载到Flash。而配置是从flash到FPGA。
    查一下配置电路！看看！

  • yuxiaohui (2008-11-21 09:56:03)

    我的配置电路也是按照FPGA的DATASHEET上接的呀，还可能有别的问题吗？

  • sunnyday (2008-11-21 10:39:11)

    可能是config_done上拉电阻小了，
    我的10k改1k才好，技术支持说直接接电源的都有

  • yuxiaohui (2008-11-21 14:37:23)

    QUOTE:

    原帖由 sunnyday 于 2008-11-21 10:39 发表
    可能是config_done上拉电阻小了，
    我的10k改1k才好，技术支持说直接接电源的都有
    应该是大了吧!我用的是10K的

  • yuxiaohui (2008-11-21 14:55:27)

    QUOTE:

    原帖由 sjh75 于 2008-11-19 18:03 发表
    说明你的FPGA没法完成配置！下载和配置是两码事。
    下载是从电脑下载到Flash。而配置是从flash到FPGA。
    查一下配置电路！看看！
    我把参考电路放在下面了，麻烦您帮看看，谢谢！

    参考图.rar
    (2008-11-21 14:55:27, Size: 9.89 KB, Downloads: 2)

  • yuxiaohui (2008-11-21 14:59:31)

    QUOTE:

    原帖由 sjh75 于 2008-11-19 18:03 发表
    说明你的FPGA没法完成配置！下载和配置是两码事。
    下载是从电脑下载到Flash。而配置是从flash到FPGA。
    查一下配置电路！看看！
    我的参考图在下面，麻烦您帮我看看，谢谢！

  • yuxiaohui (2008-11-21 16:10:30)

    下载完成之后FPGA的DCLK应该给EPCS16的DCLK一个时钟，但是我测的DCLK引脚没有时钟。这是怎么回事呢？
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