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我的 synplify 没有设置正确吗 ？

字体: 小 中 大 | 打印 发表于: 2008-9-05 23:15    作者: vfdff    来源: EDA中国门户网站

我使用ISE 9.1 +  synplify  pro 8.1 能综合成功一个代码
也能通过transfam 和 map ,但是在route 的时候出错了，提示没有满足约束
但是使用ISE 9.1自带工具进行综合的时候，route也能完成（能正确实现），是不是可能我的synplify 没有设置正确的原因呀 ？？
因为我刚使用 quartus  6.0 + synplify  pro 8.1测试过，一切没有问题的，按理这个 synplify  pro 8.1应该安装正确了！
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最新回复

  • linking234 (2008-9-06 00:39:18)

    你用哪家的片子,怎么既在xilinx的平台上跑又在altera的平台上跑？

    synplify和ise/quartus都有自己的时序分析，不过相比而言，后两者对自己的片子估计更准确一点。
    这个分析是基于芯片型号来的，你连型号都没有定，这个比起来没有意义。

    不过synplify的约束和quartus/ise的估计差别不大，你在synplify里不能通过，而在ISE里能通过，很可能是你的时序处于一种比较临界的状态。也就是说，ISE的时序报告里，slack的报告也不会好

  • vfdff (2008-9-07 00:09:55)

    我只是使用相同的源代码而已，当然在ISE 和quartus 上选择对应的器件

  • linking234 (2008-9-07 00:27:45)

    两家产品的器件结构不同，当然时序分析结果不同，所以约束不过也是正常的

  • vfdff (2008-9-07 00:30:56)

    那是不是意味：
    如果一个简单的小程序能跑通，就能说明软件安装的没有问题

  • shaweikang1984 (2008-9-07 22:04:17)

    跟软件安装没关系，可能是synplify综合结果不符合器件走线规则造成的，错误报告因该会告诉你冲突在哪的

  • songwei004 (2008-9-09 13:43:56)

    你可以选一个Xilinx比较快的片子试一下，如果能过就说明你的程序有待优化！Synplify比XST要求严的多！

  • yumingyun (2008-10-08 13:13:15)

    看看,学学
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