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下一篇 2008-06-12 15:12:37
/ 个人分类:职业生涯
这个时间,比较不招人喜欢。该怎么形容呢?很想找一句俗语来描述,可惜用的时候才发现语言的贫乏。
[p^%cBpRk9j0EDA中国门户网站D"|NEi;n 能造成这样的状况,只能说是阴差阳错,计划赶不上变化。
EDA中国门户网站-~QsZ:TF{D/a7H 本来安排的挺好的6月19日tapeout,6月20日上一版芯片回来,就可以接着测了。结果上星期二芯片就回来了。
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WJ0zk:p0L`.Mb+XxMQ0 后面的计划全都被打乱了。
+hgE?Ok/BK&z EE0 既然芯片回来了,就想初步看一看有没有什么问题--万一有比较致命的,赶紧在这一版tapeout之前改过来呀!--这样一来,测试就排在了前面。
EDA中国门户网站e:[)D&bR6CV1_:}q 问题,总归是有的。究竟是不是致命,谁又敢断言呢?所以只好尽量的测,尽量快的改了。
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M0p$f8Y 改也是小问题,因为仿真做起来终究是快的。可是仅仅仿真当然是不够的,怎么也要简单做个
FPGA吧?
EDA中国门户网站%Du7M%fnEDA中国门户网站AZ1Wz0AY%nt#qY 这个FPGA,想来是让我头疼的东西。硬件的不可见性,不稳定性,已然让我吃够了苦头。去年的金秋时节,一个IIC就让我为难了两个星期。如今情况又能好到哪里去呢?更有同事猜测梅雨天气FPGA是不是也受潮了?怎么以前好好的Bit文件现在下进去,出来的图像也满是麻点呢?
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K_U8YQu g0hc0EDA中国门户网站QN!Sk n6s%dba 猜测归猜测,要做的还是一步不能说的,否则,tapeout之前的那张单子怎么敢签字?
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nRMKm 昨天是个好天气,终于雨过天晴了,一度让我感到了欢欣鼓舞。没想到晚上就可怜的死在了这个倒霉的FPGA上。好好的代码,出来的信号就是不对。好吧,改,改的在FPGA上能出来正确的信号了,再拿去仿真,仿真结果又不对了。那就再改,改到仿真结果对了,在去放在FPGA上,又不对了----此时已经是晚上8:30了!领导也急了,研究了半天仿真结果说那就这样吧,我综合去了!至此我方可回家。打车跑到公交站点,正好赶上最后一班车还没走。只能说我运气好了,错过了公交要打车回家,100多块钱估计没人给我报销。
EDA中国门户网站S)}?M|G#]!cEDA中国门户网站7I#Uj*Np3e(^.UU5K 今天早上8点到公司,继续钻研头天晚上的问题,终于发现了问题的所在。修改,仿真,FPGA,一系列通过,已经是中午。也就是说,我的这些努力,对于这一版已经没有太大意义,因为code 已经freez了。留到下一版再改进吧。好在出问题的地方只是一套备用方案。
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