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相信自己

post sta的timing report这样报对吗？

2008-10-18 11:13:06 / 芯片综合

这是一条从input出发的timing report，其中clk network delay的值PT是自动用这个port口的约束时钟的最长的一段propagtion delay来代替，这样报对吗？我觉得因为已经设置了input delay，这里的clock network应该就是用0来计算了吧麻烦大家帮我看看

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更新时间: 2006-08-31

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